株式会社パルテック FAE（FPGA 製品取扱事業部）
- 営業職・MR
- 正社員
AMD Xilinx 社（米国）の FPGA ・ PLD と周辺デバイス（電源、高速 I/F 、メモリ
等）の機能とメリットを最大限に引き出しながら、お客様に Device 設計とボード
設計のアドバイス、提案を行う技術コンサルタント的業務です。
【募集背景】
既存顧客や既存製品に対する深耕を進めるとともに、新しい顧客や製品の拡大にチャレンジしている段階です。また親会社との連携を行いながらグループ会社とのシナジー効果を図るべく、人員を拡大しさらなる飛躍を実現するための増員となります。
【組織構成】
・部長1 名（ 40 代前半）
・課長1 名（ 40 代半ば）
・主任1 名（ 40 代後半）
・メンバー：5 名（今回の募集ポジション） ※課長以下の平均年齢 35.8
- 給与目安
- 年収： 550万円 ～
- 職種
- プリセールス,機械設計
- 雇用形態
- 正社員
- 給与
-
年収：550 万円〜 800 万円
【年収5 5 0 万の例：基本給 2 63,5 00 円 月、残業調整手当（月 20 時間分固定払
い）： 4 4 38 0 円 月、住宅手当（世帯主） 4 0,000 円 月→月額 3 47 88 0 円 月。
賞与1,3 31 250 円（夏冬合計）】
- 待遇
-
通勤手当、住宅手当、健康保険、厚生年金保険、雇用保険、労災保険、厚生年金基金、退職金制度
＜各手当・制度補足＞
通勤手当：規定により支給
住宅手当：非世帯主30,000円（規定により支給）
社会保険：各種保険完備
＜定年＞
60歳
＜教育制度・資格補助補足＞
自己啓発奨励制度、海外技術トレーニング、社内技術研修、OA研修、新人研修、OJT
＜その他補足＞
■社員持株制度（持株の購入額に20％の奨励金あり）
■企業年金制度（公的年金＋年金基金制度＋確定給付企業年金）、財形貯蓄制度
■定期健康診断（30歳以上は人間ドックを受診）
■永年勤続表彰制度
■法定以上の育児・介護者に対する時短延長制度
■新幹線通勤（最寄からの通勤時間が90分を超える場合※上限額あり）
- 勤務時間
-
＜労働時間区分＞
フレックスタイム制
コアタイム：10:00〜15:00
フレキシブルタイム：7:00〜10:00、15:00〜22:00
休憩時間：60分（11:45〜12:45）
時間外労働有無：有
＜標準的な勤務時間帯＞
9:00〜17:30
＜その他就業時間補足＞
補足事項なし
- 休日・休暇
-
完全週休2日制（休日は土日祝日）
年間有給休暇10日〜20日（下限日数は、入社半年経過後の付与日数となります）
年間休日日数127日
夏季休暇（5日）、年末年始休暇、有給休暇、慶弔・育児・特別休暇
- 応募資格
-
【必須】
・FPGA ・ PLD の設計経験、 VHDL 、 Velilog を用いての IC の設計経験
【優遇】
・ 車載関連・画像処理関連の知識、 AI に関する知識等の設計経験
・ Embedded Processor の開発・サポート経験
- 勤務地
- 東京都 港区
- 企業名・施設名
- 株式会社パルテック
- 最終更新日
- 2024年9月19日
募集状況確認フォーム
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- STEP2
- STEP3
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